配線遅延を考慮した回路モデル上でのハードウェアアルゴリズムの評価(システムレベル設計,デザインガイア2008-VLSI設計の新しい大地-)
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概要
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集積回路設計において,計算時間や面積などの要求に応じてハードウェアアルゴリズムを設計,選択することが重要となる.従来のハードウェアアルゴリズムの評価では,配線遅延を無視し,回路の段数により計算時間を評価する回路モデルが使用されていた.しかし,集積回路の微細化に伴い,論理素子の遅延に対して配線遅延が相対的に増加しており,配線遅延を考慮した,より現実に即した回路モデルが必要であると考えられる.本稿では,配線長に依存する配線遅延を仮定した回路モデルを提案し,種々のハードウェアアルゴリズムについて,計算時間を評価する.評価により,段数の小さい回路ほど配線遅延の影響が大きくなるという結果が得られた.
- 一般社団法人情報処理学会の論文
- 2008-11-10
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