並列プレフィックス加算器を用いた算術演算モジュールの自動生成(信号処理,LSI,及び一般)
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概要
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本稿では,並列プレフィックス加算器を用いた演算器モジュールジェネレータについて述べる.提案するシステムは,演算器内部の並列プレフィックス加算器をその入力信号の遅延情報を用いて高速化することができる.演算器モジュールジェネレータはまず,設計仕様に従って演算器を生成し,演算器内部の信号遅延を測定する.次に,測定結果を用いて並列プレフィックス加算器を再構築する.本稿では,高速化された並列プレフィックス加算器を用いることで乗算器,定係数乗算器,積和演算器の性能を向上できることを示す.
- 社団法人電子情報通信学会の論文
- 2007-06-15
著者
-
本間 尚文
東北大学大学院情報科学研究科
-
青木 孝文
東北大学大学院情報科学研究科
-
樋口 龍雄
東北工業大学工学部電子工学科
-
渡邉 裕樹
東北大学大学院情報科学研究科
-
Aoki Takafumi
Graduate School Of Information Sciences Tohoku University:(present Address)presto Jst.
-
Higuchi Tatsuo
Tohoku Inst. Technol. Sendai‐shi Jpn
-
Higuchi Tatsuo
Department Of Electronics Tohoku Institute Of Technology
-
Higuchi Tatsuo
Department Of Electronic Engineering Tohoku Institute Of Technology
-
Higuchi Tatsuo
The Department Of Electronics Faculty Of Engineering Tohoku Institute Of Technology
-
Higuchi Tatsuo
The Department Of System Information Sciences Graduate School Of Information Sciences Tohoku Univers
-
Higuchi Tatsuo
Hitachi Ltd. Central Research Laboratory
-
羽生 貴弘
東北大 電通研
-
渡辺 裕樹
名古屋大学大学院情報科学研究科 社会システム情報学専攻
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