冗長数系に基づく高速加算器の最適設計(ハードウェア/ソフトウェア設計技術, 信号処理, LSI, 及び一般)
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概要
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本稿では, Counter Tree Diagram (CTD)と呼ばれる高速加算アルゴリズムの統一的な表現法に基づく冗長加算器の最適設計について述べる.CTDを用いることで, 冗長加算アルゴリズムに関する特別な知識を用いることなく, 桁上げ伝搬の制限された冗長加算器を系統的に導出することができる.本稿では, 冗長2進加算器の実験的な設計を通してCTDに基づく設計手法の有効性を示す.実験の結果, 提案する設計手法により, 従来の構造と比べ電力遅延積にして30〜40%高性能な冗長2進加算器が得られることを確認した.
- 社団法人電子情報通信学会の論文
- 2005-06-21
著者
-
本間 尚文
東北大学大学院情報科学研究科
-
青木 孝文
東北大学大学院情報科学研究科
-
樋口 龍雄
東北工業大学工学部電子工学科
-
Higuchi Tatsuo
Tohoku Inst. Technol. Sendai‐shi Jpn
-
Higuchi Tatsuo
Department Of Electronics Tohoku Institute Of Technology
-
Higuchi Tatsuo
The Department Of Electronics Faculty Of Engineering Tohoku Institute Of Technology
-
Higuchi Tatsuo
Hitachi Ltd. Central Research Laboratory
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