ニューロンMOS多入力加算器による並列乗算器の設計
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概要
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高機能多入力デバイスであるニューロンMOSトランジスタ(neuMOS)を有効に利用する並列乗算器の設計および評価を行った.neuMOSの対称関数実現容易性に着目し, 多入力加算器を用いた乗算器の部分積削減部構成法を提案する.neuMOSを用いることでCMOSより高速な多入力加算器を小さい面積で実現できるため, 乗算器の省面積化, 高速化が期待できる.設計した乗算器の面積と遅延の評価を行って, neuMOS乗算器はCMOSよりも高速で面積を小さくできることを示した.
- 社団法人電子情報通信学会の論文
- 1998-02-25
著者
-
安浦 寛人
九州大学大学院システム情報科学研究院
-
安浦 寛人
九州大学大学院システム情報科学研究科情報工学専攻
-
廣瀬 啓
九州大学大学院システム情報科学研究科
-
廣瀬 啓
九州大学大学院システム情報科学研究科情報工学専攻
-
安浦 寛人
九州大学大学院 システム情報科学研究院
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