冗長2進演算を利用したマイクロプロセッサアーキテクチャ
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概要
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従来のマイクロプロセッサでは, 加減算はキャリーの伝搬遅延により他の論理, シフト演算と比較して長い演算時間を要し, これらの演算を行う際にはサイクル時間の多くが有効に利用されていない.本研究では, 冗長2進コードの演算を可能としたALUの構成を提案する.本ALUでは, 加減算において冗長2進コードの出力を許すことで, 加減算を含めた全ALU演算を, ビット幅によらない短時間で終了させ, マイクロプロセッサのステージ時間を短縮することが可能となる.また, 同ALUを用いて設計したマイクロプロセッサについて, その特徴を述べる.本プロセッサは, 命令フェッチデコードおよびレジスタファイルヘのライトバックは2ウェイのスーパスカラとして2命令並列に行う一方, 命令の実行を2倍速のクロックで動作するパイプラインで1命令ずつ順次行う.本アーキテクチャを用いることで, 同時にデコードされた2命令間に依存性がある場合でもそれらの実行を可能とすることができる.
- 社団法人電子情報通信学会の論文
- 1998-02-25
著者
-
藤島 実
東京大学大学院新額域創成科学研究科
-
鳳 紘一郎
東京大学大学院新領域創成科学研究科
-
鳳 紘一郎
東京大学新領域創成科学研究科
-
鳳 紘一郎
東京大学大規模集積システム設計教育研究センター
-
入田 隆宏
東京大学工学系研究科
-
藤島 実
東京大学大学院工学系研究科
-
小倉 誉之
東京大学工学系研究科
-
入田 隆宏
東京大学大学院工学系研究科
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