ビットレベルパイプライン手法を用いたディジタルニューロチップの最小化
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概要
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ニューロチップをディジタル回路で実現するには、加算器や乗算器といった大規模な回路が必要であり、集積シナプス数、演算速度をともに向上させることは難しい。本研究では、ビットレベルでのパイプライン処理を行うことで、シナプスをより単純な回路で実現する手法の検討を行った。以下に、本手法を用いて試作したニューロチップについて報告する。
- 社団法人電子情報通信学会の論文
- 1996-09-18
著者
-
鳳 紘一郎
東京大学新領域創成科学研究科
-
藤島 実
東京大学工学系研究科
-
鳳 紘一郎
大規模集積システム設計教育研究センター
-
入田 隆宏
東京大学工学系研究科
-
帆足 克己
大規模集積システム設計教育研究センター
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