連続時間ヒステリシスセルラーニューラルネットの実装化
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概要
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区分線形2値ヒステリシスを含む連続時間型アナログセルラーニューラルネットワークの実装回路をVLSI化を念頭において提案する. このネットワークはニューラルタイプオシレータを基本としており、安定平衡点、周期解、非周期解などの多彩な現象を呈し、これらを情報と対応付けることが出来ればより多機能なニューラルネットの実現が可能である。さらにこのネットワークでA/DコンバータやWinner Take All回路などにも応用も可能である. 本論文ではこのネットワークの実装回路を比較的簡潔なMOS回路で構成し, セル単体の発振をSPICEでシミュレーションした.
- 社団法人電子情報通信学会の論文
- 1996-09-27
著者
-
田中 衞
上智大学理工学部情報理工学科
-
神野 健哉
上智大学理工学部電気電子工学科
-
田中 衛
上智大学理工学部情報理工学科
-
伊久 信
上智大学理工学部電気・電子工学科
-
伊久 信
上智大学理工学部電気電子工学科
-
田中 衞
上智大学理工学部
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