Verilog-HDLを用いたセルオートマトンのFPGA化
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概要
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本稿ではディジタル回路用ハードウェア記述言語であるVerilog-HDLを用いて2次元セルオートマトンをFPGA上に設計する。この2次元セルオートマトンは5×5に配置されたオートマトンで構成される。本システムを用いた連想メモリを提案し、その想起能力について考える。セルオートマトンの状態遷移行列は記憶パターンの局所相関学習を基に設定した。本システムは離散時間セルラーニューラルネットと深く関連している。本稿での結果は大規模ニューラルネットワークの電子回路での実装化の基本となるものである。
- 2002-03-08
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