Wired-ORを併用したトランスダクション法による高速論理回路設計
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概要
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論理回路設計において最大ファンインに対する制限が加えられることが多いが、ファンイン制限を満足する回路は一般に、素子数や回路の段数が多くなる。ファンイン制限をWired-Logicを用いて行えば、回路の段数の増加を押えられると考えられる。Wired-Logicは結線の状態によっては使用できないが、トランスダクション法における許容関数を用いて使用できるか判断すると、回路の形状のみから判断するよりも多くの場合にWired-Logicを利用することが可能となる。本稿では、Wired-ORを併用して、できるだけ回路の段数を増加させないように、NOR回路のファンイン制限を行なう手法の実現および実験結果について報告する。
- 社団法人情報処理学会の論文
- 1993-03-01
著者
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