Deterministic BISTのためのテストデータ圧縮の一手法(<特集>システムLSIの設計技術と設計自動化)
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概要
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本論文では,ROMに貯えられたテストデータを1ビットずつシフトして被検査組合せ回路(CUT)のテストパターンとするdeterministic BIST方式において,コンパクトなテストデータを作成する有効な一手法を提案する.提案手法は,C1-compatibilityを用いた回路入力幅圧縮後のCUTに対してコンパクトなATPGベクトル集合の生成を行った後,この集合をもとにしてコンパクトなテストデータを作成する.そのために提案手法では,(1)ATPGベクトルだけでなくシフトベクトルでの故障検出も考慮した故障検出困難度を用いてROMに格納するATPGベクトル数を小さくするとともに,(2)不要ビット削除に基づくビット単位でのテストデータ圧縮を行っている.提案手法の有効性をISCASベンチマーク回路に対する評価実験によって示す.とくに,c2670やc7552等,乱数パターンで検出しにくい故障を多く持つ回路に対して大きな効果があることを示す.
- 一般社団法人情報処理学会の論文
- 2002-05-15
著者
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