組合せ回路におけるテスト数制限下でのI_<DDQ>テスト集合の一生成法 : Cyclic greedy法
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概要
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使用できるテストパターン数に制限(上限)がある場合における検出故障数最大化を目的とするIDDQテスト集合の生成法-Cyclic greedy生成法-を提案する。これは, greedyに一通り制限数のテストパターンを生成した後, 各テストパターンをはじめから一つずつ再生成し直すことを繰り返す手法である。個々のテストパターンは, 乱数パターンをできるだけ多くの未検出故障を検出する方向に改善していく乱数逐次改善法国, [6], [7]を用いることにより生成する。評価実験により本手法の有効性を示す。
- 社団法人電子情報通信学会の論文
- 2001-07-01
著者
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