入力信号パターンを考慮した低電力算術演算回路の設計手法
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概要
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算術演算器はマイクロプロセッサをはじめ,画像処理などの様々なLSIの重要な構成要素である.デイジタル信号処理プロセッサ(DSP)や動画像処理プロセッサでは並列乗算器の性能がシステム性能を左右する.算術演算回路の設計においては1ビット全加算器(FA)やカウンタなどを基本セルとして用いて設計が行われる.本論文では,各基本セルへの入力信号パターンの偏りの影響を考えて,回路構造の異なる複数の基本セルの中から最も適したセルを選択したり,セルの対称な入力端子への配線を変更したりすることで算術演算回路の消費電力を削減する一手法を提案する.提案する手法により乗算器の消費電力を32.1%削減できることを示し,回路の最適化手法も提示する.
- 一般社団法人情報処理学会の論文
- 2001-04-15
著者
-
安浦 寛人
九州大学大学院システム情報科学研究院
-
安浦 寛人
九州大学大学院システム情報科学研究科情報工学専攻
-
兵頭 章彦
九州大学大学院システム情報科学府情報工学専攻
-
室山 真徳
九州大学大学院システム情報科学府情報工学専攻
-
石原 亨
東京大学大学院大規模集積システム設計教育研究センター
-
安浦 寛人
九州大学大学院 システム情報科学研究院
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