配線遅延を考慮したハードウェアアルゴリズムの評価
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概要
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従来,ハードウェアアルゴリズムの計算時間は,組合せ回路モデルにおける回路の段数により評価してきた.回路の各論理素子での遅延を定数値とし,配線による遅延を無視するという仮定の下では,回路の計算時間は回路の段数に比例する.しかし,実際は論理素子の遅延は配線の長さに依存する.そこで本稿では,配線長に依存する配線遅延を仮定した回路モデルを提案し,種々の並列乗算のハードウェアアルゴリズムについて,回路全体の配線遅延を見積もり,計算時間を評価する.評価により,部分積の累算を木構造により行う種々の乗算器において,計算時間のオーダーが従来のモデルによる評価と異なるという結果が得られた.
- 社団法人電子情報通信学会の論文
- 2007-12-07
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