算術演算回路のレイアウトのためのビットスライス構造の抽出
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概要
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多くの算術演算回路はビットスライス構造と呼ばれる特徴的な回路構造をもつ。ビットスライス構造をもつ回路には入力データの各ビットを計算をする部分回路の間に規則性が存在する。この構造を回路から抽出し、レイアウトに反映させることによって総配線長の減少や小面積化が期待できる。本稿では算術演算回路のビットスライス構造の抽出手法を提案する。提案手法は、ネットリストに現れる規則的な回路構造の情報とHDL記述の情報を利用してビットスライス構造を抽出する。本手法を実装し、実験により配列型乗算器や互除法に基づく有限体上の除算器などの算術演算回路でビットスライス構造が抽出できることを示した。
- 2001-11-28
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