準同期方式を用いたLSIのピーク消費電力の削減(システムオンシリコン設計技術並びにこれを活用したVLSI)
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概要
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LSIの大規模化に伴うピーク消費電力の増加は,ゲートの不安定動作や誤動作の原因となるため,対策が必要である.本研究は準同期方式を用いてこのピーク消費電力が低くなるように回路を設計することを目的とする.本研究ではクロックスケジュールの設定に用いる高速な電力の見積り手法を提案し,また,この見積り手法を使用してピーク電力を減少するように,クロックスケジュールを改善する手法を提案する.完全同期式回路,準同期方式における最小のクロック周期を達成しさらにクロックタイミングを分散させた準同期式回路,提案手法により得られたクロックタイミングを用いた準同期式回路を用意し,それぞれにsoiceレベルのシミュレーションを行ない比較することで,提案手法によってピーク電力の低い回路を得られることを確認し,その有効性を示した.
- 社団法人電子情報通信学会の論文
- 2004-03-04
著者
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