論理合成ツールを用いたSFQ論理回路の設計方法の検討(エレクトロニクス・一般)
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概要
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現在のSFQ論理回路では、設計の自動化が確立されていないため、設計者が論理合成から配置配線まで全てを行っている.そこで,我々はSFQ論理回路設計の自動化を目標とし、論理合成ツールの導人を検討している.本報告では,半導体集積回路の論理合成ツールを用いてSFQ論理回路の論理合成を行う方法について検討する.まず,既存の半導体集積回路の論理合成ツールを使用するために論理合成用ライブラリを作成した.しかし,半導体論理ゲートはUnclocked gateであるのに対し, SFO論理ゲートはClocked gateであるため,本提案では,設計手順を論理合成とクロック分配の2つの段階に分けて行った.さらに,クロック分配ではスループットを上げるために, D-FF(D-Flip Flop)を挿人してゲート間の遅延時間を調整し,クリティカル・パスの改善を行った.今回提案する設計方法を用いてSFQマイクロプロセッサCORE1βのコントローラをSFQ論理回路で設計し,シミュレーションで正常動作を確認した.
- 社団法人電子情報通信学会の論文
- 2004-10-15
著者
-
山梨 裕希
横浜国立大学大学院工学府
-
吉川 信行
横浜国立大学大学院工学府
-
吉川 信行
横浜国立大学:jst-crest
-
秋本 彩
横浜国立大学
-
吉川 信行
横浜国立大学 工学部 電子情報工学科
-
山梨 裕希
横浜国立大学大学院
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