高性能システム・オン・チップ構成法に関する性能評価
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概要
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トランジスタ集積度およびマイクロプロセッサの動作周波数は順調に向上している. 現在, コンピュータ・システムの高速化の阻害要因として, 命令レベル並列度の限界, マイクロプロセッサ設計の複雑度および開発期間の増大, フオン・ノイマン・ボトルネックといったものが挙げられる. 一方, これまでのMPUチップ+DRAMチップというシステムの分チップ構成とは異なるメモリ-ロジック混載チップが登場している. 本稿では, これらの技術背景を踏まえた上での今後の1チップ上での高性能システムか採る構成法上のアプローチを整理し, その内で有望と思われる構成法に対して性能評価を行っている.
- 1996-08-28
著者
-
村上 和彰
九州大学大学院システム情報科学府
-
岩下 茂信
九州大学大学院総合理工学研究科
-
宮嶋 浩志
九州大学大学院システム精報科学研究科情報工学専攻
-
宮嶋 浩志
九州大学 大学院システム情報科学研究科 情報工学専攻
-
岩下 茂信
九州大学大学院システム情報科学研究科情報工学専攻
-
村上 和彰
九州大学大学院 システム情報科学研究院 情報理学部門
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