VHDLを用いた論理回路の消費電力見積り方法の提案 : 32ビットアダー回路の消費電力についての考察
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概要
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本論文ではVHDLの処理系を用いて,CMOS型集積回路の消費電力を評価する方法を提案する.まず,VHDLのネットリスト記述をVHDL処理系に入力し,各基本セルの出力を計測することにより,消費電力を評価する方法について述べる.次にこの方法を用いて,実現方法(アーキテクチャ)が異なる数種類の32ビットアダーについて,実現方法とトグル数の関係を調査した結果について報告する.
- 一般社団法人情報処理学会の論文
- 1995-05-26
著者
-
今井 正治
豊橋技術科学大学
-
塩見 彰睦
静岡大学情報学部情報科学科
-
塩見 彰睦
豊橋技術科学大学情報工学系
-
木村 勉
豊田工業高等専門学校
-
山本 俊之
豊橋技術科学大学
-
満田 千秋
豊橋技術科学大学
-
引地 信之
SRA
-
引地 信之
SRA先端技術研究所
-
木村 勉
豊田工業高等専門学校情報科学専攻
-
塩見 彰睦
豊橋技術科学大学
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