複数の同種類演算器を用いるパイプラインASIPの性能最大化設計のためのHW/SW分割アルゴリズム
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概要
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本稿では,複数の同種類演算器(MIFUs)を有するパイプラインCPUアーキテクチャにもとづく特定用途向き集積化プロセッサ(ASIP)の開発のための,新しいHW/SW分割アルゴリズムを提案する.この分割問題は,要求される各々のタイプの演算器の最適な選択を行ない,与えられたゲート数と消費電力の制約条件のもとで, ASIPの性能を最大にするように,基本演算をハードウェアまたはソフトウェアで実現する組み合せ最適化問題として定式化する.次に,この問題を解く分枝限定アルゴリズムを示す.また,提案したアルゴリズムの効果と効率を示す実験の結果を示す.
- 社団法人電子情報通信学会の論文
- 1996-07-26
著者
-
武内 良典
大阪大学大学院情報科学研究科
-
今井 正治
大阪大学大学院情報科学研究科
-
塩見 彰睦
静岡大学情報学部
-
塩見 彰睦
静岡大学情報学部情報科学科
-
ビン グエンゴク
大阪大学大学院基礎工学研究科 情報数理系専攻
-
今井 正治
大阪大学大学大学院情報科学研究科
-
武内 良典
大阪大学大学大学院情報科学研究科
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