パイプライン段数を考慮したASIP設計最適化の検討
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概要
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従来のパイプライン・プロセッサ設計最適化手法では,初期にアーキテクチャの基本となるパイプライン段数を固定し,最適化を行ってきた.本稿では,パイプライン・プロセッサ設計最適化においてパイプライン段数もパラメタとして追加し,設計探索空間を広げることによって、一層適用範囲の広いASIP設計最適化手法を検討した結果について報告する.評価実験からプロセッサのパイプライン・ステージ数,動作周波数,プロセッサが使用するハードウェア・コストと,プログラムの実行時間の間にはトレード・オフが存在することが知られた.
- 一般社団法人情報処理学会の論文
- 1999-09-20
著者
-
武内 良典
大阪大学大学院情報科学研究科
-
今井 正治
大阪大学大学院情報科学研究科
-
北嶋 暁
大阪大学大学院基礎工学研究科情報数理系専攻
-
北嶋 暁
大阪電気通信大学 総合情報学部情報工学科
-
篠原 克哉
大阪大学大学院基礎工学研究科情報数理系専攻
-
今井 正治
大阪大学大学大学院情報科学研究科
-
武内 良典
大阪大学大学大学院情報科学研究科
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