パイプライン・ハザードを考慮したプロセッサ生成手法の提案(<特集>電子システムの設計技術と設計自動化)
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概要
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本論文では, マルチサイクル演算, 遅延分岐, および外部割込みに対応したプロセッサ生成手法を提案する.本手法では, HWインタロック機構, 遅延分岐機構, および外部割込み制御機構を持つパイプライン・プロセッサのモデルを用いて, クロック単位の命令のマイクロ動作記述を含む設計仕様記述からプロセッサのデータパスおよび制御論理を生成する.提案手法では, 命令のマイクロ動作記述から得られる情報を基に, (1)データパスの生成, (2)マルチサイクル演算によるHWインタロックの制御論理の生成, (3)分岐の制御論理の生成, および(4)割込み制御論理の生成を行う.MIPSR3000のサブセット命令を有するプロセッサについて, 生成結果の妥当性およびプロセッサの設計仕様記述の変更容易性を評価し, 提案手法の有効性を確認した.
- 一般社団法人情報処理学会の論文
- 2000-04-15
著者
-
武内 良典
大阪大学大学院情報科学研究科
-
今井 正治
大阪大学大学院情報科学研究科
-
佐藤 淳
鶴岡工業高等専門学校電気電子工学科
-
塩見 彰睦
静岡大学情報学部
-
塩見 彰睦
静岡大学情報学部情報科学科
-
佐藤 淳
鶴岡工業高等専門学校電気電子工学科:エイシップ・ソリューションズ株式会社
-
伊藤 真紀子
大阪大学大学院基礎工学研究科情報数理系専攻:(現)株式会社半導体理工学研究センター
-
佐藤 淳
鶴岡工業高等専門学校
-
今井 正治
大阪大学大学大学院情報科学研究科
-
武内 良典
大阪大学大学大学院情報科学研究科
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