ASIP設計用ワークベンチPEAS-IIIの実現方法についての考察 : CPUアーキテクチャの分類とパラメタ化
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概要
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ASICのコデザインに関する研究は種々行なわれているが,現状ではコデザインで用いられるCPUアーキテクチャがかなり限定されているのが現状である.しかし実際には対象となるアプリケーションの分野に応じてCPUのアーキテクチャを変化させた方が良い結果が得られると考えられる.本稿ではASIP設計用ワークベンチであるPEAS-IIIシステムのアーキテクチャ記述入力系のプロトタイピングを行なった結果を報告する.特に様々なアーキテクチャに対応できる手法について述べる.また実現の際に得られた所見についても述べる.
- 一般社団法人情報処理学会の論文
- 1995-12-14
著者
-
今井 正治
豊橋技術科学大学
-
佐藤 淳
鶴岡工業高等専門学校電気電子工学科
-
塩見 彰睦
静岡大学情報学部情報科学科
-
塩見 彰睦
豊橋技術科学大学情報工学系
-
佐藤 淳
鶴岡工業高等専門学校電気電子工学科:エイシップ・ソリューションズ株式会社
-
引地 信之
SRA
-
引地 信之
SRA先端技術研究所
-
青山 義弘
福井高専 電子情報工学科
-
片岡 健二
豊橋技術科学大学
-
青山 義弘
豊橋技術科学大学
-
佐藤 淳
鶴岡工業高等専門学校
-
塩見 彰睦
豊橋技術科学大学
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