Varchsyn(8) : タイミング最適化II
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概要
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半導体市場での高クロック周波数で動作するLSIへの要求が高まり、クリティカルパスの遅延削減が大きな問題となっている。論理合成は合成結果の回路の遅延が、指定された遅延制約を満足することを目的にタイミング最適化処理を行なう。本稿では、論理合成システムVarchsynにおけるテクノロジーに依存したタイミング最適化手法について述べる。
- 社団法人情報処理学会の論文
- 1993-03-01
著者
-
藤田 悟
NEC情報通信メディア研究本部
-
藤田 悟
法政大学情報科学部ディジタルメディア学科
-
藤田 悟
Nec C&c研究所
-
淺香 俊治
NEC
-
江村 秀之
NEC
-
河原林 政道
NEC
-
前田 直孝
NEC
-
江村 秀之
NECエレクトロニクス
-
江村 秀之
Nec Ulsiシステム開発研究所
-
河原林 政道
NEC ULSIシステム開発研究所
-
河原林 政道
Nec Ulsiシステム開発研
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