ニューロンMOSFETを用いた多値ラッチ回路の高性能化
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概要
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Abstract A multiple-valued logic(MVL) circuit is a basic circuit which performs MVL digital processing. In this paper, a MVL latch circuit are presented, that holds a given MVL level. Originally, the MVL latch has been proposed by Mirmotahari, et. al. We improve it's characteristics with neuron MOSFETs. The noise margin is 30.0[m.Ⅴ] compared with 48.0[mⅤ] in the original circuits.
- 宮崎大学の論文
著者
-
淡野 公一
宮崎大学 工学部
-
石塚 興彦
第一工業大学
-
淡野 公一
宮崎大学工学部
-
石塚 興彦
宮崎大学工学部
-
中山 悠
宮崎大学工学研究科電気電子工学専攻
-
石塚 /興彦
宮崎大学
-
淡野 公一
宮崎大学工学部電気電子工学科
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