組込みシステムのアーキテクチャ探索における性能ボトルネック解析(システム設計技術(1),デザインガイア2012-VLSI設計の新しい大地-)
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概要
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本論文では,ソフトウェアとハードウェアが混在した組込みシステムのボトルネック部分に対し,設計制約を満たすために必要な性能と面積の改善率を同時に探索する手法を提案する.提案手法は,性能見積もりツールに与える入力情報を変更し,性能向上時の実行時間とハードウェア面積を見積もることで,改善率の探索を実現する.AES暗号化復号システムの設計事例を通し,提案手法を用いることで,短時間で効率的にシステムの性能向上が実現できることを示す.
- 2012-11-19
著者
-
高田 広章
名古屋大学
-
安藤 友樹
国立豊田工業高等専門学校
-
冨山 宏之
名古屋大学大学院情報科学研究科
-
冨山 宏之
九州大学大学院システム情報科学研究科
-
冨山 宏之
名古屋大学
-
冨山 宏之
財団法人九州システム情報技術研究所
-
富山 宏之
九州大学大学院システム情報科学研究科
-
本田 晋也
名古屋大学大学院情報科学研究科付属組込みシステム研究センター
-
安藤 友樹
名古屋大学 大学院情報科学研究科
-
本田 晋也
名古屋大学大学院情報科学研究科
-
本田 晋也
名古屋大学
-
本田 晋也
名古屋大学 大学院情報科学研究科
-
冨山 宏之
立命館大学
-
柴田 誠也
名古屋大学
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