FPGAを用いた全探索法による可変ブロックサイズ動き予測の実現(リコンフィギャラブル応用1)
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概要
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本論文では,FPGAを用いた全探索法による可変ブロックサイズ動き予測の計算手法を示す.我々の手法では,参照フレームが格納されているオフチップメモリと,探索領域のデータがキャッシュされているオンチップメモリへのアクセスを低減させるため,符号化対象フレームのマクロブロックのスキャン方向と探索領域における適合計算のスキャン方向を最適化した.この手法によって,探索範囲が[-32,+32]×[-32,+32]のとき,DVDサイズでリアルタイム処理を実現した.我々の手法は実用的な範囲においてスケーラブルであり,探索範囲が[-64,+64]×[-64,+64]のとき,回路規模が16倍の大きさになるが,HDサイズでリアルタイム処理を実現できる.この場合,マクロブロックのサイズを64×64画素まで拡大することができる.
- 社団法人電子情報通信学会の論文
- 2010-05-06
著者
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