動的電圧制御をする自己同期型プロセッサ(システムオンシリコン設計技術並びにこれを活用したVLSI)
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概要
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クロック同期回路では、PVTぱらつきが大きくなるにつれて信頼性が低下し、遅延マージンが大きくなってきている。終了検出型の自己同期回路はクロック信号を用いずに演算の終了を検出して次の演算を行う回路であり、PVTばらつきによる遅延変動では誤動作を起こさない。終了検出型の自己同期回路は二線式論理を用いたDCVSLドミノ回路を用いて設計することができるため、この回路の自動設計手法を確立し、プロセッサを設計した。このプロセッサは動的電圧制御を行うことで目標速度に追従させることができる。自己同期型プロセッサは遅延の平均値で動作するため最大遅延よりも速く動作する。このため同期回路と協調して動作させるときは、その時間差が低消費電力化として活用される。
- 2008-02-29
著者
-
浅田 邦博
東京大学大規模集積システム設計教育研究センター
-
池田 誠
東京大学 大学院 工学系研究科
-
浅田 邦博
東京大学 大学院 工学系研究科
-
浅田 邦博
東京大学大学院工学系研究科電子工学専攻
-
浅田 邦博
東京大学大規模集積システム設計教育研究センター(vdec):東京大学大学院工学系研究科電気系工学専攻
-
曽我部 拓
東京大学
-
浅田 邦博
東京大学
-
池田 誠
東京大学
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