リアルタイム制約とSEU脆弱性制約の下でのヘテロジーニアスマルチプロセッサ合成技術(高信頼システム,システム設計及び一般)
スポンサーリンク
概要
- 論文の詳細を見る
短期間で,かつ低コストに組込みシステムを開発する設計パラダイムとして,ヘテロジーニアスマルチプロセッサがしばしば用いられる.一方で,微細加工技術が進展するにつれて,シングルイベントアップセット(SEU:Single Event Upset)といった信頼性に関する問題が関心事となっている.本稿では,一定の処理を行う間に生じるSEU数をSEU脆弱性と定義し,SEU脆弱性とリアルタイム性を考慮したヘテロジーニアスマルチプロセッサ合成技術に関する議論を行う.ヘテロジーニアスマルチプロセッサ合成問題を混合整数計画問題として定式化する.計算機実験を行い,合成されるヘテロジーニアスマルチプロセッサのリアルタイム制約,SEU脆弱性,及びチップ面積に関する考察を行う.
- 2008-05-02
著者
-
杉原 真
豊橋技術科学大学情報工学系
-
杉原 真
独立行政法人科学技術振興機構,JST
-
杉原 真
豊橋技術科学大学大学院工学研究科情報・知能工学系|独立行政法人科学技術振興機構 Crest
-
杉原 真
豊橋技術科学大学:独立行政法人科学技術振興機構 Jst
-
杉原 真
独立行政法人科学技術振興機構 Jst
関連論文
- トラフィック情報に基づくリングバスのスループットを向上させるタスク配置手法 (ディペンダブルコンピューティング)
- キャッシュメモリの性能オーバーヘッドを低減させるタスクスイッチ手法の検討(オペレーティングシステム・システムソフトウェア)
- タスクスイッチによって生じるキャッシュメモリの性能オーバーヘッドの定量的評価 (ディペンダブルコンピューティング)
- 部分一括描画装置の処理能力向上のための描画面積最適化(計算機システム化技術,システムLSI設計とその技術)
- マイクロプロセッサにおける制御信号系列の誤りを検出する動的シグネチャ検査技術 (画像工学)
- マイクロプロセッサにおける制御信号系列の誤りを検出する動的シグネチャ検査技術 (集積回路)
- マイクロプロセッサにおける制御信号系列の誤りを検出する動的シグネチャ検査技術 (信号処理)
- タスクスイッチによって生じるキャッシュメモリの性能オーバーヘッドの定量的評価(ハードウェア(II),組込み技術とネットワークに関するワークショップ ETNET2010)
- NoCを利用した特定用途向けシステムのスループットを向上するIPコアトポロジ決定手法(コンピュータシステム技術2,組込み技術とネットワークに関するワークショップ ETNET2010)
- トラフィック情報に基づくリングバスのスループットを向上させるタスク配置手法(コンピュータシステム技術1,組込み技術とネットワークに関するワークショップ ETNET2010)
- 固定型ルーティングを実装したNoCの通信エネルギーを低減するハードマクロ配置手法(ネットワークオンチップ,システムオンシリコンを支える設計技術)
- AI-1-6 ディペンダブルVLSI設計技術への挑戦(AI-1.デイベンダブルVLSIに向けて,依頼シンポジウム,ソサイエティ企画)
- マイクロプロセッサにおける制御信号系列の誤りを検出する動的シグネチャ検査技術
- タスクスイッチによって生じるキャッシュメモリの性能オーバーヘッドの定量的評価(ハードウェア(II),組込み技術とネットワークに関するワークショップETNET2010)
- トラフィック情報に基づくリングバスのスループットを向上させるタスク配置手法(コンピュータシステム技術1,組込み技術とネットワークに関するワークショップETNET2010)
- NoCを利用した特定用途向けシステムのスループットを向上するIPコアトポロジ決定手法(コンピュータシステム技術2,組込み技術とネットワークに関するワークショップETNET2010)
- マイクロプロセッサにおける制御信号系列の誤りを検出する動的シグネチャ検査技術
- キャラクタプロジェクション法のためのセルライブラリ開発手法(プロセッサ, DSP, 画像処理技術及び一般)
- キャラクタプロジェクション法のためのセルライブラリ開発手法(プロセッサ, DSP, 画像処理技術及び一般)
- キャラクタプロジェクション法のためのセルライブラリ開発手法(プロセッサ, DSP, 画像処理技術及び一般)
- キャラクタプロジェクション法のためのセルライブラリ開発手法(プロセッサ, DSP, 画像処理技術及び一般)
- リアルタイム制約とSEU脆弱性制約の下でのヘテロジーニアスマルチプロセッサ合成技術(高信頼システム,システム設計及び一般)
- リアルタイム制約とSEU脆弱性制約の下でのヘテロジーニアスマルチプロセッサ合成技術(システム設計及び一般)
- プログラムの動作を考慮したコンピュータシステムのソフトエラー数見積もり技術(プロセッサ, DSP, 画像処理技術及び一般)
- プログラムの動作を考慮したコンピュータシステムのソフトエラー数見積もり技術(プロセッサ, DSP, 画像処理技術及び一般)
- プログラムの動作を考慮したコンピュータシステムのソフトエラー数見積もり技術(プロセッサ, DSP, 画像処理技術及び一般)
- プログラムの動作を考慮したコンピュータシステムのソフトエラー数見積もり技術(プロセッサ, DSP, 画像処理技術及び一般)
- IPコアの多重接続許容下において通信仕様を満たす通信機構合成手法 (ディペンダブルコンピューティング)
- IPコアの多重接続許容下において通信仕様を満たす通信機構合成手法 (コンピュータシステム)
- ソフトエラーを低減する高信頼性キャッシュメモリのためのタスクスケジューリング(デザインガイア2006-VLSI設計の新しい大地を考える研究会)
- コンピュータシステムにおける信頼性と性能のトレードオフの解析と高信頼性キャッシュアーキテクチャ(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- コンピュータシステムにおける信頼性と性能のトレードオフの解析と高信頼性キャッシュアーキテクチャ(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- コンピュータシステムにおける信頼性と性能のトレードオフの解析と高信頼性キャッシュアーキテクチャ(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- コンピュータシステムにおける信頼性と性能のトレードオフの解析と高信頼性キャッシュアーキテクチャ(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- ヘテロジーニアスマルチプロセッサのソフトエラー脆弱性を低減するタスクスケジューリング技術(システムオンシリコン設計技術並びにこれを活用したVLSI)
- ヘテロジーニアスマルチプロセッサのソフトエラー脆弱性を低減するタスクスケジューリング技術(システムオンシリコン設計技術並びにこれを活用したVLSI)
- キャラクタプロジェクション法における描画面積の最適化による描画時間の削減(組込技術とネットワークに関するワークショップETNET2006)
- キャラクタプロジェクション法における描画面積の最適化による描画時間の削減(組込技術とネットワークに関するワークショップETNET2006)
- キャラクタプロジェクション法における描画面積の最適化による描画時間の削減(組込技術とネットワークに関するワークショップETNET2006)
- A-3-5 固定型ルーティングを実装したNoCの通信エネルギーを低減するハードマクロ配置手法の提案(A-3.VLSI設計技術,一般セッション)
- IPコアの多重接続許容下において通信仕様を満たす通信機構合成手法
- IPコアの多重接続許容下において通信仕様を満たす通信機構合成手法
- ハードリアルタイム性を考慮したFlexRayのバス帯域幅の最小化技術
- ハードリアルタイム性を考慮したFlexRayのバス帯域幅の最小化技術
- ハードリアルタイム性を考慮したFlexRayのバス帯域幅の最小化技術(車載システム,組込み技術とネットワークに関するワークショップETNET2012)
- ハードリアルタイム性を考慮したFlexRayのバス帯域幅の最小化技術(車載システム,組込み技術とネットワークに関するワークショップETNET2012)
- 焼きなまし法を用いたTDMAスケジューリング技術(システムレベル設計技術,組込み技術とネットワークに関するワークショップETNET2013)
- 焼きなまし法を用いたTDMAスケジューリング技術(システムレベル設計技術,組込み技術とネットワークに関するワークショップETNET2013)
- 2.3 設計自動化技術(第2章:放射線によるソフトエラー,ディペンダブルVLSIシステム)