リアルタイム制約とSEU脆弱性制約の下でのヘテロジーニアスマルチプロセッサ合成技術(システム設計及び一般)
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概要
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短期間で,かつ低コストに組込みシステムを開発する設計パラダイムとして,ヘテロジーニアスマルチプロセッサがしばしば用いられる.一方で,微細加工技術が進展するにつれて,シングルイベントアップセット(SEU:Single Event Upset)といった信頼性に関する問題が関心事となっている.本稿では,一定の処理を行う間に生じるSEU数をSEU脆弱性と定義し,SEU脆弱性とリアルタイム性を考慮したヘテロジーニアスマルチプロセッサ合成技術に関する議論を行う.ヘテロジーニアスマルチプロセッサ合成問題を混合整数計画問題として定式化する.計算機実験を行い,合成されるヘテロジーニアスマルチプロセッサのリアルタイム制約,SEU脆弱性,及びチップ面積に関する考察を行う.
- 2008-05-01
著者
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杉原 真
豊橋技術科学大学情報工学系
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杉原 真
独立行政法人科学技術振興機構,JST
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杉原 真
豊橋技術科学大学大学院工学研究科情報・知能工学系|独立行政法人科学技術振興機構 Crest
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杉原 真
豊橋技術科学大学:独立行政法人科学技術振興機構 Jst
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杉原 真
独立行政法人科学技術振興機構 Jst
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