マルチスレッドプロセッサにおける再構成可能キャッシュメモリ
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概要
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近年,リコンフィギャラブルデバイスを用いたシステムが多数登場しており,今後それらに用いられるプロセッサの高性能化が予想される.プロセッサの高性能化にマルチスレッド化があるが,複数のスレッドで1つのキャッシュを共有している場合,キャッシュミスが頻発し,性能が低下する.そこで,本稿では,リコンフィギャラブルデバイスを対象とし,マルチスレッドプロセッサにおいて,プログラムごとにキャッシュ構成を再構成させる方式を提案した.設計したキャッシュ構成の中で性能比較を行い,プログラムに最適な構成を選定し,性能向上率を見積もった.その結果,従来の固定方式に比べ15.12%の性能向上を確認した.提案した再構成可能キャッシュメモリは,キャッシュサイズを増加させず,Wayとブロックサイズのみを再構成し,性能向上を目指すので,チップ面積の有効活用やキャッシュサイズ増加の抑制につながる.
- 一般社団法人情報処理学会の論文
- 2006-06-26
著者
-
小笠原 嘉泰
東京農工大学大学院工学府
-
中條 拓伯
東京農工大学
-
並木 美太郎
東京農工大学
-
浅野 一成
東京農工大学工学府情報工学科
-
佐藤 未来子
東京農工大学大学院工学府情報工学専攻
-
内倉 要
東京農工大学大学院工学教育部
-
笹田 耕一
東京農工大学大学院工学教育部
-
笹田 耕一
東京大学大学院情報理工学系研究科
-
笹田 耕一
東京農工大学大学院工学府
-
笹田 耕一
東京大学:(現)東京大学大学院情報理工学系研究科創造情報学専攻
-
小笠原 嘉泰
東京農工大学
-
佐藤 未来子
東京農工大学大学院工学府
-
渡邉 聡
東京農工大学大学院工学府
-
館 一平
東京農工大学大学院工学府
-
内倉 要
東京農工大学大学院:(現)(株)小松製作所
-
中條 拓伯
東京農工大
-
佐藤 未来子
東京農工大学
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