FPGAを用いたSMTプロセッサの実現と再構成可能キャッシュメモリの検討(設計手法と高性能化, リコンフィギャラブルシステム, 一般)
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概要
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近年, FPGAの高速化, 集積度の増加により, 大規模なプロセッサを実装することが可能となった.マルチスレッドプロセッサのキャッシュメモリは, 複数のスレッドを実行するため, プログラムごとに最適な構成, スレッド間の共有度などが異なる.本稿では, キャッシュメモリの再構成を念頭に, FPGAにSMTプロセッサを実装し, キャッシュメモリ構成をプログラムごとに再構成するモデルについて検討した.その結果, SMT化による性能向上を確認し, ハードウェア増加量はシングルスレッドプロセッサと比較して1.3倍程度に抑え, 動作周波数はおよそ80MHzとなった.さらに, プログラムに最適なキャッシュメモリ構成を選定し, 再構成による性能向上を確認した.
- 社団法人電子情報通信学会の論文
- 2005-05-05
著者
-
小笠原 嘉泰
東京農工大学大学院工学府
-
中條 拓伯
東京農工大学
-
並木 美太郎
東京農工大学
-
佐藤 未来子
東京農工大学大学院工学府情報工学専攻
-
加藤 義人
東京農工大学大学院工学教育部:(現)ソニー株式会社
-
内倉 要
東京農工大学大学院工学教育部
-
笹田 耕一
東京農工大学大学院工学教育部
-
大和 仁典
東京農工大学大学院工学教育部
-
笹田 耕一
東京大学大学院情報理工学系研究科
-
笹田 耕一
東京農工大学大学院工学府
-
笹田 耕一
東京大学:(現)東京大学大学院情報理工学系研究科創造情報学専攻
-
小笠原 嘉泰
東京農工大学
-
佐藤 未来子
東京農工大学大学院工学府
-
大和 仁典
東京農工大学大学院工学教育部:(現)株式会社東芝
-
内倉 要
東京農工大学大学院:(現)(株)小松製作所
-
中條 拓伯
東京農工大
-
大和 仁典
東京農工大学 大学院 工学教育部
-
加藤 義人
東京農工大学 大学院 工学教育部
-
佐藤 未来子
東京農工大学
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