PLL技術を用いた低電力2.5Gb/sタイミング抽出・識別再生IC
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概要
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次世代の超大容量光通信システム構築に向けて, 光送受信モジュールの低消費電力化、小型化、低コスト化が進められている。特に光受信モジュールにおいて、タイミング抽出・データ識別再生回路 (CDR)の1チップ化(完全モノリシック化)が有効な手段となる。 これまでに我々は高価な外付部品を必要としない、PLL技術を用いた2.5Gb/s CDRICを開発し、その有効性を検証してきた。今回、低電力化構成技術、並びに0.5μ-Siバイポーラ技術を用いて大幅な低電力化と完成度の向上を達成したので報告する。
- 社団法人電子情報通信学会の論文
- 1997-08-13
著者
-
市野 晴彦
Nttマイクロシステムインテグレーション研究所
-
石原 昇
Ntt光エレクトロニクス研究所
-
広瀬 正樹
NTTグループ企業本部
-
市野 晴彦
NTT光ネットワークシステム研究所
-
広瀬 正樹
NTTシステムエレクトロニクス研究所
-
岸根 桂路
NTTシステムエレクトロニクス研究所
-
石原 昇
Ntt フォトニクス研
-
岸根 桂路
Ntt マイクロシステムインテグレーション研
-
岸根 桂路
NTT光ネットワークシステム研究所
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