高性能DFFの検討
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概要
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スタンダードセル部において占有面積が最も大きくなるDFFの小型化, 低電力化は, チップ全体のサイズ・消費電力低減に極めて有効である. 提案するDFFは, TSPC(True-single-phrase clocking)を実現したセミスタティック構成の回路であり, 従来の回路に対して, 消費電力低減, トグル周波数向上, ノイズ耐性改善の3つを達成することに成功している. また, NMOSがPMOSの倍近いトランジスタ数にもかかわらず, NMOSのみを多段化するレイアウトにより, 0.25μmプロセスで従来の小型DFFと同等以下の横幅ピッチ数を実現している.
- 社団法人電子情報通信学会の論文
- 1997-06-19
著者
-
近藤 利夫
三重大学
-
草場 律
システムエレクトロニクス研究所 : (現)マルチメディアシステム開発推進センタ
-
近藤 利夫
三重大学工学部
-
草場 律
NTTシステムエレクトロニクス研究所
-
近藤 利夫
(現)NTTヒューマンインターフェイス研究所
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