減衰シナプスの単電子回路化とその熱雑音特性
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概要
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近年、金澤らはCMOS VLSIによる減衰シナプス回路を用いたバースト同期情報検出のデモンストレーションを行い[1], [2]、回路中のスタティックノイズ(デバイスのばらつき)が同期検出のパフォーマンスを向上させることを示した[2]。本稿は、金澤らの報告にあるニューラルネットワークのアーキテクチャを単電子回路に導入し、そのノイズ耐性を調べることを目的とする。そのために、減衰シナプスを単電子回路化し、それを用いた同期検出ニューラルネットを設計する。回路シミュレーションにより、この単電子ニューラルネットがノイズを利用して同期検出のパフォーマンスを向上させることを示す。
- 社団法人電子情報通信学会の論文
- 2005-03-21
著者
-
浅井 哲也
北海道大学 大学院 情報科学研究科
-
雨宮 好仁
北海道大学 大学院 情報科学研究科
-
廣瀬 哲也
北海道大学 大学院 情報科学研究科
-
加賀谷 亮
北海道大学大学院情報科学研究科情報エレクトロニクス専攻
-
加賀谷 亮
北海道大学大学院情報科学研究科
-
大矢 剛嗣
北海道大学工学部電子工学科
-
大矢 剛嗣
北海道大学大学院情報科学研究科
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