ブロック図によるHDLベース設計環境
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概要
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論理合成を主体としたトップダウン設計手法の一形態として,ブロック図による論理合成可能なハードウェア記述言語(HDL)ベース設計環境について述べる.定型的な機能は,ビット幅などのパラメータ入力により,論理合成可能な機能記述を自動生成し,新規の機能記述は論理合成可能なHDL記述へ対話的に変換する.これらをブロック図形式で接続することにより,HDL記述の知識が少ない設計者でも,論理合成を意図した機能設計が視覚的にできる.また論理合成からの後戻りが少なくなり,再利用設計が促進され,設計効率の向上が図れる.評価例では,従来のテキストベースの設計と比較して記述量を22%削減できた.
- 社団法人情報処理学会の論文
- 1994-06-24
著者
-
中村 彰
長崎大学工学部電気情報工学科
-
野地 保
三菱電機株式会社システムlsi開発研究所
-
野地 保
三菱電機(株) Cl研(情)
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中村 彰
長崎大学工学部
-
濱田 英幸
三菱電機(株)
-
水本 勝也
三菱電機(株)
-
高坂 広之
三菱電機(株)
-
青木 洋
三菱電機(株)
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水本 勝也
三菱電機(株)システムlsi開発研究所
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青木 洋
三菱電機(株)システムlsi開発研究所
-
高坂 広之
三菱電機(株)システムlsi開発研究所
-
濱田 英幸
三菱電機(株)システムlsi開発研究所
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