並列処理における動的負荷分散方式 : 帳尻合わせ方式
スポンサーリンク
概要
- 論文の詳細を見る
先に報告した並列処理用テストベッド(68000×16台、PE間の通信は主としてルータネットワークによる)の上で並列処理を効率よく行うことができる動的負荷分散方式-帳尻合わせ方式-を提案し、その実行制御機構と予備評価について述べる。
- 一般社団法人情報処理学会の論文
- 1986-10-01
著者
関連論文
- 部分再構成システムにおけるAES-GCMを用いたビットストリームの秘匿と認証(応用1)
- 超高精細映像に対応したバーサタイルメディアプロセッサ : スケーラブルな並列映像オーバレイエンジン(ディジタル・情報家電,放送用,ゲーム機用システムLSI,回路技術(一般,超高速・低電力・高機能を目指した新アーキテクチャ))
- 超高精細映像に対応したバーサタイルメディアプロセッサ--スケーラブルな並列映像オーバレイエンジン (コンシューマエレクトロニクス)
- FPGAを用いたコンテンツ保護システムの設計と開発(ソフトウェア・著作権保護,情報システムを支えるコンピュータセキュリティ技術の再考)
- 組込用リアルタイムプロセッサ開発計画(プロセッサ)
- リアルタイムイーサネットとその予備的評価(ネットワーク)
- センサフュージョンのためのリアルタイムパラレルアーキテクチャ
- 実時間用並列計算機アーキテクチャの検討
- CODAにおけるスキップ機構の導入による共有変数アクセスの効率化
- CODAアーキテクチャ : 命令挿入によるレジスタ上でのデータ待ち合わせ
- 高並列計算機における遠隔データの先行フェッチのためのループ変換手法
- 僅か数十バイトの追加情報で実現する簡易3次元表示 : グラフィックエンジンを持たない組込機器でも良好な表示(応用,組込技術とネットワークに関するワークショップETNET2009)
- 任意の画像を任意の位置に重畳表示することで大きさ理解を促進する簡易3次元表示方式
- 大きさを実感できる写真表示方式
- 超高速ネットワーク対応URLフィルタリング装置の開発(ディペンダブルシステム,組込み技術とネットワークに関するワークショップ ETNET2010)
- 高速かつ軽量な可変データ長対応のCRC回路構成手法(組み込みシステムアーキテクチャ)
- 「ネットワークを渡り歩けるコンピュータ」を利用したネットワークトラヒック削減のための動的負荷分散手法(ネットワークソフトウェア論文)
- B-19-27 「ネットワークを渡り歩けるコンピュータ」を利用した動的負荷分散手法における予測(B-19. ネットワークソフトウェア, 通信2)
- 小型カードプロセッサカードとそのリアルタイム応用
- 小型カードプロセッサカードとそのリアルタイム応用
- 組込応用向き小型プロセッサカードの予備的評価
- 市販プロセッサとFPGAから構成される計算ノードをもつ実時間並列システムアーキテクチャ
- プロフィールに基づく染色体ソータ
- 外国製計算機への日本語文の埋め込み
- 関数レベルデータ駆動計算機の検討
- 並列処理における動的負荷分散方式 : 帳尻合わせ方式
- 並列構造記述モデルとそれを実現する高水準並列計算機
- 超高速ネットワーク対応URLフィルタリング装置の開発(ディペンダブルシステム,組込み技術とネットワークに関するワークショップETNET2010)
- 組込用リアルタイムプロセッサ開発計画
- 「ネットワークを渡り歩けるコンピュータ」とモバイルIPの連携による負荷分散手法の提案
- 「ネットワークを渡り歩けるコンピュータ」とモバイルIPの連携による負荷分散手法の提案
- 「ネットワークを渡り歩けるコンピュータ」とモバイルIPの連携による負荷分散手法の提案
- 「ネットワークを渡り歩けるコンピュータ」の差分転送実験
- 「ネットワークを渡り歩けるコンピュータ」の差分転送実験
- インプリサイス計算を用いた柔軟なリアルタイムシステムの構築を目指して
- 僅か数十バイトの追加情報で実現する簡易3次元表示 : グラフィックエンジンを持たない組込機器でも良好な表示(応用,組込技術とネットワークに関するワークショップETNET2009)
- 僅か数十バイトの追加情報で実現する簡易3次元表示 : グラフィックエンジンを持たない組込機器でも良好な表示(応用,組込技術とネットワークに関するワークショップETNET2009)
- 僅か数十バイトの追加情報で実現する簡易3次元表示 : グラフィックエンジンを持たない組込機器でも良好な表示(応用,組込技術とネットワークに関するワークショップETNET2009)
- FPGAによる高速かつ軽量なNFAパターンマッチング回路(FPGA応用)
- 組込/分散/実時間用JavaにおけるGC及びスケジューリング機構の設計
- 組込/分散/実時間用JavaにおけるGC及びスケジューリング機構の設計
- FTS2000-22 多段網において優先度逆転を抑制するための熱心な優先度先送り方式の提案と評価
- FTS2000-16 インプリサイス計算に基づいた自動車制御スケジューリングとその基本的性能評価
- インプリサイス実時間スケジューリングの予備的性能評価
- 並列・分散をめざした実時間組込み用Javaの基本設計
- インプリサイス計算を用いた自動車走行制御スケジューリングのアシュアランス
- サイドチャネル攻撃に対する標準評価ボードとツールの開発(ツール,デザインガイア2008-VLSI設計の新しい大地)
- FPGAの動的部分再構成を用いたマルチ暗号モジュールの回路規模と消費電力の削減
- リアルタイムイーサネットのシミュレーションによる評価(2003年並列/分散/協調処理に関する「松江」サマーワークショップ(SWoPP松江2003))(DC-1高信頼化手法)
- リアルタイムイーサネットとその予備的評価
- 可変精度の実時間タスクを重要度により制御するインプリサイススケジューリングの考察
- 組込みから並列・分散までの実時間Javaの統一環境の設計と実装
- Linuxカーネル上でのイーサネット優先度制御・フロー制御機構の実装と評価(組込技術とネットワークに関するワークショップETNET2006)
- Linuxカーネル上でのイーサネット優先度制御・フロー制御機構の実装と評価(組込技術とネットワークに関するワークショップETNET2006)
- Linuxカーネル上でのイーサネット優先度制御・フロー制御機構の実態と評価(組込技術とネットワークに関するワークショップETNET2006)
- 動的部分再構成による回路規模と消費電力の削減についての一考察(低消費電力化技術)
- 動的部分再構成による回路規模と消費電力の削減についての一考察(低消費電力化技術)
- 動的部分再構成による回路規模と消費電力の削減についての一考察(低消費電力化技術)
- 動的部分再構成による回路規模と消費電力の削減についての一考察(低消費電力化技術)
- IEEE Real-Time Systems Simposium (RTSS'00)及びInt'l Conference on Real-Time Computing Systems and Applications (RTCSA'00)の会議報告
- IEEE Real-Time Systems Simposium (RTSS'00)及びInt'l Conference on Real-Time Computing Systems and Applications (RTCSA'00)の会議報告
- IEEE Real-Time Systems Simposium (RTSS'00) 及び Int'l Conference on Real-Time Computing Systems and Applications (RTCSA'00) の会議報告
- 車両の位置情報を交換する無線プロトコルの実験(応用,組込技術とネットワークに関するワークショップETNET2008)
- 車両の位置情報を交換する無線プロトコルの実験(応用,組込技術とネットワークに関するワークショップETNET2008)
- 車両の位置情報を交換する無線プロトコルの実験(応用,組込技術とネットワークに関するワークショップETNET2008)
- 車両の位置情報を交換する無線プロトコルの実験(応用,組込技術とネットワークに関するワークショップETNET2008)
- 複数パイプライン・プロセッサの実時間性能評価
- リアルタイムシステムのハードウエア
- 実時間並列計算機CODAにおけるネットワーク性能の予備的評価
- 実時間処理向き並列ハードウェアエミュレータシステムの構成
- CODAプロセッサにおける実時間処理向きタスクスイッチの性能評価
- 実時間用並列計算機CODAのプロセッサアーキテクチャ
- 優先度先送り方式による実時間相互結合網用ルータチップの実現と性能
- 優先度先送り方式による実時間用相互結合網用ルータチップの性能評価
- FPGAの自己動的部分再構成を利用したセキュアなコンテンツ配信システムの構築(DRP,FPGA)
- FPGAの自己動的部分再構成を利用したセキュアなコンテンツ配信システムの構築(DRP,FPGA)
- 臨界投機実行のWWW情報検索への応用
- 実時間処理のためのネットワーク制御方式について (リスポンシブシステム実時間性と高信頼性の統合を目指して)
- 3. 実時間処理のためのハードウェアアーキテクチャ ( リアルタイムシステム)
- 実時間並列計算機CODAの命令セットの予備評価
- 実時間並列計算機CODA用ルータチップの予備的性能評価
- 実時間並列計算機CODAの命令セット・アーキテクチャ設計
- 実時間並列計算機CODAの構成とメンテナンスアーキテクチャ
- WPDRTS'99, RTSS'99と併設のワークショップRTMCS, RTCSA'99の参加報告
- 第5回実時間計算システムと応用国際会議(RTCSA'98)の参加報告
- 全画面やフレームレートという概念を排除した新しい表示方式の提案
- 全画面やフレームレートという概念を排除した新しい表示方式の提案
- FPGAを用いたAndroid OS性能評価システムの開発(ネットワークソフトウエア(ソフトウエアアーキテクチャ,ミドルウエア),NWアプリケーション,SOA/SDP,NGN/IMS/API,分散制御・ダイナミックルーチング,グリッド,NW及びシステム信頼性,NW及びシステム評価,一般)
- 高速リアルタイムデータ収集用ネットワークレコーダの開発(ディペンダブルシステム,組込み技術とネットワークに関するワークショップETNET2011)
- 高速リアルタイムデータ収集用ネットワークレコーダの開発(ディペンダブルシステム,組込み技術とネットワークに関するワークショップETNET2011)
- 第4回実時間計算システムと応用国際会議(RTCSA'97)の参加報告
- センサフュージョンのための並列計算機システム
- FPGAを用いたUltra-Android用性能評価システムの開発
- FPGAを用いたUltra-Android用性能評価システムの開発
- 全画面やフレームレートという概念を排除した新しい表示方式の提案(組込み技術とネットワークに関するワークショップETNET2011)
- 全画面やフレームレートという概念を排除した新しい表示方式の提案(組込み技術とネットワークに関するワークショップETNET2011)
- 先行制御機構をもつデ-タ駆動計算機EM-3の評価
- FPGAを用いたUltra-Android用性能評価システムの開発(ディペンダビリティと評価,組込み技術とネットワークに関するワークショップETNET2012)
- FPGAを用いたUltra-Android用性能評価システムの開発(ディペンダビリティと評価,組込み技術とネットワークに関するワークショップETNET2012)
- 大規模FPGAを用いた規模拡張可能な高速ネットワーク侵入検知システムの開発