動的部分再構成による回路規模と消費電力の削減についての一考察(低消費電力化技術)
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概要
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FPGAの動的部分再構成を利用し,複数のモジュールを切り替えて実装することで,回路面積や消費電力がどの程度削減可能であるか評価した.現在市販されているFPGAには,回路の一部のみを動作中に再構成可能なものがあり,様々な機能を環境や用途に合わせて柔軟に変更するとともに,回路規模や消費電力の削減につながると期待されている.今回,6つの標準的な暗号モジュール(AES, Camellia, SEED, TDEA, MISTY1, CAST-128)を用い,これらを同時に実装した場合と,1つずつ切り替えて実装した場合のリソース使用量と消費電力を評価した.
- 社団法人電子情報通信学会の論文
- 2008-01-09
著者
-
堀 洋平
独立行政法人産業技術総合研究所
-
戸田 賢二
独立行政法人産業技術総合研究所
-
戸田 賢二
産業技術総合研究所
-
戸田 賢二
産業技術総合研究所情報技術研究部門
-
戸田 賢二
産業技術総合研究所 情報技術研究部門
-
戸田 賢二
National Institute For Advanced Industrial Science And Technology (aist):information Technology Rese
-
堀 洋平
中央大学研究開発機構
-
坂根 広史
独立行政法人産業技術総合研究所
-
戸田 賢二
電子技術総合研究所所
-
堀 洋平
産業技術総合研究所情報セキュリティ研究センター
-
戸田 賢二
独立行政法人 産業技術総合研究所
-
堀 洋平
中央大 研究開発機構
-
坂根 広史
産業技術総合研究所情報セキュリティ研究センター
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