確率的符号化時間記号シミュレーションによるタイミングエラー確率の解析
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概要
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非同期回路に対するタイミング検証において,遅延の不確定性が原因で生じるハザードなどによるタイミングエラーのおこる確率を求めることは,タイミングエラーの有無を判定することと同様に重要な問題である.本論文では,遅延の大きさが不確定で,その最小値と最大値が与えられているような論理素子によって構成された非同期回路において,ハザードなどによるタイミングエラーがおこる確率を正確に求める手法として,確率的符号化時間記号シミュレーションという新たな手法を提案する.本手法は,以前に提案したタイミング検証の一手法であり,記号シミュレーションによって正確な結果を得る「符号化時間記号シミュレーション」を基にしている.本方法では,信号線の依存関係を論理関数の形で保持することにより,従来回路中の再収れんによって不正確にしか求られなかったタイミングエラー確率を正確に計算することができる.
- 一般社団法人情報処理学会の論文
- 1993-05-15
著者
-
矢島 脩三
京都大学工学部情報工学教室
-
石浦 菜岐佐
大阪大学工学部情報システム工学科
-
矢島 脩三
京都大学大学院工学研究科情報工学教室
-
石浦 菜岐佐
関西学院大学
-
出口 豊
京都大学工学部情報工学科
-
矢島 脩三
京都大学工学研究科情報工学専攻
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