配線長を考慮したクラスタリングに基づくスタンダードセル階層配置手法(VLSIの設計/検証/テスト及び一般配置配線)
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概要
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近年,半導体技術の急激な進歩に伴い/回路全体のパフオーマンスを決定する要素として配線遅延が重要となってきている.そこで,配線長の短縮を考慮したセルのクラスタリングを行って問題サイズを減少させ,クラスタ単位でセル配置を決定する階層配置手法が一般的に用いられている.従来の手法ではクラスタ単位の配置の際にクラスタ内のネット情報を利用していなかったが,本稿では階層設計においてクラスタ内のセル配置を考慮しながらクラスタ配置を行う手法を提案する.提案手法では最終配置において近隣に配置されることが望ましいセルをクラスタ配置時に考慮するために,クラスタ内のセルに対して中心セル,境界セル,非境界セルなどのセル集合に分類する.このようにすることで,提案手法は階層設計において後の階層で決定されるセル配置を前もって予測することが可能になり,配線長の短い優れたセル配置を生成することができる.
- 社団法人情報処理学会の論文
- 2003-11-27
著者
-
辻 敏夫
広島大学大学院工学研究科
-
若林 真一
広島市立大学大学院情報科学研究科
-
窪田 創
広島大学大学院工学研究科
-
小出 哲士
広島大学ナノデバイス・システム研究センター
-
小出 哲士
広島大学
-
辻 敏夫
広島大学大学院 工学研究院
-
若林 真一
広島市立大学大学院 情報科学研究科
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