クロック系消費電力に着目した可変段数パイプラインプロセッサの低電力化(計算機システム)
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概要
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近年,モバイル端末等の消費エネルギーの増大が問題となっており,低消費エネルギーと高性能の両立が要求されている.そこで我々は,その要求を満たす手法の一つとしてVSP(Variable Stages Pipeline)を提案している.VSPはパイプライン段数を動的に変化させることで低消費エネルギーと高性能の両立を目指す手法である.また,LDS-cellという特殊なセルを導入することでパイプラインステージ統合によって増加する回路内のグリッチを削減している.しかし,LDS-cellはグリッチを低減するためにクロックを供給する必要があるため,クロックトリーの消費エネルギーが増大する危険性がある.そこで本論文ではLDS-cellの駆動によるオーバヘッドを低減する手法として,LDS-cellへのクロックゲーティング適用と,高性能セミスタティックTSPC DFFをベースとした改良型LDS-cellを提案する.更に,二つの提案手法を併用した場合に発生する問題点を解決する手法も提案する.提案手法を実装し,評価を行ったところ,従来VSPから18%消費エネルギーが低減できた.
- 2011-04-01
著者
-
佐々木 敬泰
三重大学大学院工学研究科
-
大野 和彦
三重大学大学院工学研究科
-
近藤 利夫
三重大学大学院工学研究科
-
中林 智之
三重大学工学部
-
佐々木 敬泰
三重大学
-
中林 智之
三重大学大学院工学研究科情報工学専攻
-
中林 智之
三重大学大学院工学研究科
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