拡張テンプレート動き検出用4画素精度ビット切り詰め型探索ユニットの設計(ディジタル・情報家電,放送用,ゲーム機用システムLSI,回路技術(一般,超高速・低電力・高機能を目指した新アーキテクチャ))
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概要
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ビット幅を2ビットに切り詰めたエッジ抽出成分の差分絶対値和に,1ビットに切り詰めたブロック構成ラインごとの平均値の差分絶対値を併用することで探索精度の低下を抑える新たなブロックマッチング法を開発した.本稿ではこの新たなマッチング法を,ブロック間のSAD共有率の高まる2×2ブロック拡張の異形状拡張テンプレート併用法に組み合わせることで,1080i対応の階層型動き検出器の一次探索部の4画素精度探索ユニットの設計を行った.この探索ユニットはPE480個からなる.PEアレイ部,その出力より拡張テンプレートごとの予測ブロックとの間の不一致度(差分絶対値和)を算出する部分和演算部,最小の差分絶対値和を検出する比較部で構成している.0.18μm5層メタル配線のCMOSテクノロジを用い,周波数108MHzで動作させる条件で設計したところ,実効探索並列度1当たりの面積が別途設計の3×3ブロック拡張,ビット切り詰め無しのものに比べ65%低減された結果,全体のレイアウト面積は1.96×1.96mm^2となった.
- 社団法人電子情報通信学会の論文
- 2007-12-06
著者
-
佐々木 敬泰
三重大学大学院工学研究科
-
大野 和彦
三重大学大学院工学研究科
-
近藤 利夫
三重大学大学院工学研究科
-
片野 智健
三重大学大学院工学研究科
-
上念 三郎
三重大学工学部
-
片野 智健
三重大学 工学研究科
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