LSI電源設計検証のための順序回路の最大動作率解析(高速化/低消費電力化I,デザインガイア2006-VLSI設計の新しい大地を考える研究会)
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概要
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本稿では,LSIオンチップ電源設計検証のために,順序回路に対して動作率ができるだけ大きい入力パタンを効率的に生成する方法を提案する.本手法ではATPGベースの同時動作ペア解析を導入することで,最大動作率解析問題を最大クリーク問題に帰着する.実験により大規模回路にも適用でき,質のよいパタンが得られることを示す.
- 社団法人電子情報通信学会の論文
- 2006-11-22
著者
-
樋口 博之
(株)富士通研究所cad研究部
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樋口 博之
(株)富士通研究所
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金澤 裕治
(株)富士通研究所
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盛山 修
(株)富士通研究所
-
伊藤 則之
富士通(株)
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金澤 裕治
株式会社富士通研究所itコア研究所cad研究部
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金澤 裕治
富士通研究所
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