メモリ配置最適化によるウェイ予測キャッシュの低消費電力化(システムオンシリコン設計技術並びにこれを活用したVLSI)
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概要
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プロセッサに占めるキャッシュの消費電力の割合は年々増加傾向にある.キャッシュの消費電力を削減するため,ウェイ予測キャッシュを考慮したマシンコードのメモリ配置最適化を提案する.ウェイ予測キャッシュの性能は,いかに所望のデータが存在するウェイを予測して,ウェイ予測ミス率を引き下げるかに掛かっている.ウェイ予測ミスは,ウェイ予測にMRU (Most Recently Used)を用いた場合,競合が原因で発生する.メモリ配置最適化によって競合を解消することで,キャッシュミス率およびウェイ予測ミス率を削減し,キャッシュの消費電力をさらに削減する.実験の結果,ウェイ予測キャッシュとメモリ配置最適化の併用により,それら単体を用いた場合のエネルギー削減率の和となるエネルギー削減効果が得られることを確かめた.
- 2006-03-02
著者
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