Charge Packet Count技術とDual-Line PWM信号処理を用いたAD融合最小距離検索回路
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概要
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アナログ・デジタル融合回路アーキテクチャに基づいた最小距離検索回路を0.8μmCMOS技術で設計・試作した.8次元・8ビットPWM信号ベクトルを4ビット・サブPWMパルス列で表現し、そのベクトル間距離演算をスイッチト電流積分法とCharge Packet Count技術により演算する.最小値検索はテジタル領域で実行する.テストチップは24KTr+12Capからなり、1GOPS/W,14MOPS/mm^2を実現した.
- 社団法人電子情報通信学会の論文
- 1997-04-25
著者
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