CMOSデジタル回路の基板雑音定量評価と低雑音化レイアウト指針
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概要
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基板雑音を100ps-100μV分解能で定量的に評価した。デジタルブロックの活性化率に雑音振幅は比例し、その低減は直接的で普遍的に基板雑音抑圧効果を示す。一方、雑音発生側でのKelvinグラウンド適用と雑音敏感な回路近傍でのガードバンド接地の併用により基板雑音振幅の75%程度を減衰できるが、その効果はリンギングなど低い周波数成分に限られることがわかった。
- 社団法人映像情報メディア学会の論文
- 2000-09-21
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