低電力・高速差動チョッパ型コンパレータ

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概要

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• 近年、バッテリ駆動の携帯機器の需要拡大に伴い低電圧駆動・低消費電力LSIに対する要望が高まっている。特にアナログLSIの分野においては、ビデオ携帯端末の高性能化の要求から高い変換速度(20Msps以上) をもつA/D変換器(分解能8-10bit)の低電力化(数十mW以下)が望まれている。これらのA/D変換器には、高速・低電力動作の他にシステムオンチップ(アナログ/デジタル混載化)の観点から小面積化、ノイズ耐性の向上ということも求められている。これらの要望を満たすA/D変換器を実現するためには、重要な機能ブロックであるコンパレータの高速・低電力化およびノイズ耐性向上が必要不可欠である。そこで今回、デジタルLSIと整合性がよく低コストなCMOS技術を用いて、低電力・高速でかつノイズ耐性の高い全差動チョッパ型コンパレータを新たに考案した。

• 社団法人電子情報通信学会の論文
• 1995-03-27

著者

• 山口 基

  Necエレクトロニクス(株)

• 四柳 道夫

  NECエレクトロニクス株式会社基盤技術開発本部

• 長谷川 寛

  NECマイクロエレクトロニクス研究所

• 四柳 道夫

  NECマイクロエレクトロニクス研究所

• 山口 基

  NECマイクロエレクトロニクス研究所

• 長谷川 寛

  NEC マイクロエレクトロニクス研究所

• 四柳 道夫

  Necエレクトロニクス(株)

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