小規模回路で実現可能なニューラルネットワークのハードウェア化手法
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概要
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本稿では, 小規模回路で実現可能なニューラルネットワークのハードウェア化手法を提案する.回路規模を低減するため, 入出力にパルス信号を用いたパルスニューロンとして配線領域を削減するとともに, 結合係数の乗算およびシグモイド関数演算を確率的に演算することで, 乗算回路とシグモイド関数用メモリを不要とした.入力信号値は, 複数の基準パルス列と入力パルス列間の相対遅延時間が正規分布となるようにコーディングする.提案手法をFPGA上にマッピングして提案を見積もった結果, 回路規模を従来の約1/13に小型化できることが明らかになった.
- 2000-02-04
著者
-
石黒 章夫
東北大学大学院工学研究科電気・通信工学専攻
-
石黒 章夫
名古屋大学大学院工学研究科
-
川島 毅
株式会社デンソー
-
川島 毅
(株)デンソー
-
川島 毅
株式会社デンソー基礎研究所
-
大熊 繁
(財)名古屋産業科学研究所
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