可変構造キャッシュシステム搭載のバス結合型並列計算機テストベッド / ATTEMPT-1の実装と評価
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概要
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バス結合型並列計算機ATTEMPT-1はマルチプロセッサチップを含む将来のマルチプロセッサにおけるキャッシュの構造を研究するために我々が開発しているテストベッドである. ATTEMPT-1では, 各部に複数の種類のPLD(FPCA,CPLD)を使い分ける事により, 柔軟性が高くしかもある程度高速に動作するキャッシュ評価環境を実現する. キャッシュ, バスの制御およびテストベッドに不可欠なパフォーマンスモニタは, SRAM型CPLDにより実装され, , キャッシュプロトコル, バスの動作速度等はハードウェア記述言語で記述を書き換える事により変更することができる. 一方, キャッシュのデータパス等高速動作が要求される部分はアンチヒューズ型FPGAを用いて実装され, 高速性を保ちつつ, 様々なキャッシュサイズ, ラインサイズ, ウェイ数を実現することができる. 上記の構造によりマルチプロセッサチップを意識Lた様々な条件を設定して, 評価を行なうことができる.
- 社団法人電子情報通信学会の論文
- 1996-08-26
著者
-
天野 英晴
慶應義塾大学大学院理工学研究科
-
天野 英晴
慶應義塾大学
-
寺澤 卓也
東京工科大学メディア学部
-
井上 敬介
(株)ソニーコンピュータサイエンス研究所
-
寺沢 卓也
慶應義塾大学理工学部
-
寺澤 卓也
東京工科大学情報通信工学科
-
井上 敬介
慶應義塾大学理工学部
-
木村 克行
慶應義塾大学理工学部
-
木透 徹
慶應義塾大学 理工学部
-
奥野 通貴
慶應義塾大学理工学部
-
木村 克行
大阪大学工学部
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