非決定性順序機械によるハードウェア記述言語の意味付け
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概要
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ハードウェア記述言語(以下HDL)はハードウェア設計を計算機によって支援するためにハードウェアの設計や仕様を記述するのに用いられる言語である。HDLに厳密な意味を形式的に与える事は、設計の形式的検証や、言語処理系の性質の証明などの立場から重要である。HDLの意味は基礎となるハードウェアの動作のモデルが定義され、その上で定義される。これまでに提案されているHDLのためのモデルとしてVHDL、CONLANのそれぞれの言語を定義するのに用いられているモデルや、NESモデル等がある。これらは設計者が直観的に考えるハードウェアの動作に近いモデルとなるように工夫されているが、反面、モデルが繁雑になり、設計検証をはじめとするモデルの数学的な扱いを困難にしている。本稿ではHDLの意味付けのためのモデルとして単純で数学的な扱いが容易であり、設計検証が可能である非決定性順序機械モデルについて考察する。
- 一般社団法人情報処理学会の論文
- 1989-10-16
著者
-
矢島 脩三
京都大学工学部情報工学教室
-
石浦 菜岐佐
京都大学工学部
-
石浦 菜岐佐
関西学院大学
-
矢島 脩三
京都大学 工学部
-
甲村 康人
三洋電機株式会社 ハイパーメディア研究所
-
甲村 康人
京都大学
-
矢島 脩三
京都大学
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