共有二分決定図を用いた組合せ論理回路のテスト生成
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概要
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組合せ論理回路のテストパタン(故障検査入力)を高速に求めるアルゴリズムは種々研究されており、多くの故障に対するテストパタンは現実的な時間で求めることができる。しかしテスト生成問題はNP完全であり、バックトラック回数の多くなる故障が存在する。このような故障に対するテスト生成法として二分決定図を用いる方法が提案されているが、本稿ではさらに効率の良い共有二分決定図を用いた単一故障伝播によるテスト生成法を提案する。
- 1989-03-15
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